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Design Verification Engineer

年収:800万 ~ 1200万

ヘッドハンター案件

部署・役職名 Design Verification Engineer
職種
業種
勤務地
仕事内容 • Verify product like ARM processor based SOC and memory subsystem test chips
• Develop verification methodology and implement test bench components using System Verilog, UVM, and low power verification
• Develop comprehensive test plan and implement test cases to verify different test chips
• Work closely with Design and DFT teams to develop/verify various functional/DFT tests
• Write functional cover groups and cover points for coverage closure. Perform RTL code coverage, System Verilog Assertion coverage, System Verilog functional coverage
• Drive and adopt new verification methodologies and flows for efficiency improvements.
労働条件 屋内禁煙、屋内原則禁煙(喫煙室あり)
応募資格

【必須(MUST)】

• BCH and above in EE, CS related fields with 3-15 years of hands-on experience
• Strong problem solving, debugging and programming skills (Python/TCL/C++)
• Strong hands-on experience with architecting and developing IP/SoC level reusable verification environments using SystemVerilog UVM methodologies.
• Hands-on experience developing testbench and testcases in System Verilog
• Knowledge in Constrained Random and Coverage Driven testbench
• Gate Level Simulation experience
• Proficiency in English is a must

【歓迎(WANT)】

英語が得意

更新日 2021/10/06
求人番号 1903493

採用企業情報

この求人の取り扱い担当者

  • 3.72
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    • 東京都
    • 東洋大学 工学部 情報工学科
  • メーカー 商社
    • 弊社は半導体業界に特化した転職エージェントになります。非公開案件も多数ございます。半導体業界での転職を希望されている方は是非お気軽にご連絡ください。
    • (2022/02/01)

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