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（設計・PDK技術部）TEG（Test Element Group） Layout [Analog]

年収：800万 ～ 1500万

ヘッドハンター案件

部署・役職名 （設計・PDK技術部）TEG（Test Element Group） Layout [Analog]
職種
業種
勤務地
仕事内容 半導体テストチップのレイアウトDesign及び、プロセスのPPA評価用レイアウトDesignを担当して頂きます。マニュアルでのレイアウトの他に、TCL言語、SKILL言語、その他の言語でスクリプト作成してレイアウト作業をして頂きます。
先端プロセスのFEOL・BEOLレイアウトルールを理解し、カスタムセル設計可能なレベルのスキルを身に着けて頂く必要があります。また、新たに構築する設計フローに対するトライアル、ツール動作検証、改善提案業務などを担当して頂きます。ジョブローテーションが頻繁にありますので、re－skilling能力が重視されます。
応募資格

【必須（MUST）】

専門性：回路設計（Layout）

経験：アナログ回路設計（ハードマクロ設計）、レイアウト設計、ライブラリ作成（.v、LEF、.libなど）
先端プロセスの使用経験（28nm以降）
スクリプト言語の使用経験（Python, TCL, shell, SKILLなど）
（自社IP開発に対する意欲があれば尚可）

語学力：TOEIC 600 以上、もしくは同等程度

リモートワーク

可

「可」と表示されている場合でも、「在宅に限る」「一定期間のみ」など、条件は求人によって異なります
受動喫煙対策

その他

「就業場所が屋外である」、「就業場所によって対策内容が異なる」、「対策内容は採用時までに通知する」 などの場合がその他となります。面接時に詳しい内容をご確認ください
更新日 2024/01/17
求人番号 3220523

採用企業情報

この求人の取り扱い担当者

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